Cyrix 6x86

6x86/MII
Description de cette image, également commentée ci-après
Un processeur Cyrix 6x86-P166
Informations générales
Production

De

  • 6x86 - Octobre 1995
  • 6x86L - Janvier 1997
  • 6x86MX - Juin 1997
  • MII - Mai 1998 à
  • 6x86 - Juin 1999
  • 6x86L - Juin 1999
  • 6x86MX - Mai 1998
  • MII - Début années 2000
Fabricant
Performances
Fréquence 80 MHz à 333 MHz
Fréquence du FSB 40 MHz à 100 MHz
Taille du cache
Niveau 1
  • 16 KB (6x86/L)
  • 64 KB (6x86MX / MII)

Spécifications physiques
Nombre de transistors 4,3M (500 nm)
Cœur

1

  • M1
  • M1L (faible tension)
  • M1R (3M à 5M)
  • MII (MMX)
Socket(s) Socket 7, Super Socket 7
Architecture et classification
Architecture IA-32/x86
Micro-architecture 6x86

Produits, modèles, variantes
Variantes 6x86, 6x86L, 6x86MX
Historique
Cyrix 6x86MX PR200

Le Cyrix 6x86 est une gamme de microprocesseurs x86 32 bits de sixième génération conçue et commercialisée par Cyrix en 1995. Cyrix, en tant que société sans usine, a fait fabriquer les puces par IBM et SGS-Thomson. Le 6x86 a été conçu comme un concurrent direct de la gamme de microprocesseurs Pentium d'Intel, et était compatible avec les broches. Pendant le développement du 6x86, la majorité des applications (logiciels de bureautique et jeux) effectuaient presque exclusivement des opérations sur des nombres entiers. Les concepteurs prévoyaient que les applications futures conserveraient très probablement ce type d'instructions. Ainsi, afin d'optimiser les performances de la puce pour ce qu'ils pensaient être l'application la plus probable de l'unité centrale, les ressources d'exécution des nombres entiers ont reçu la majeure partie du budget des transistors.

Cela s'est avéré être une erreur stratégique, car la popularité du P5 Pentium a incité de nombreux développeurs de logiciels à optimiser à la main le code en langage d'assemblage, afin de tirer parti du FPU du P5 Pentium, qui est étroitement lié au pipeline et présente une latence plus faible. Par exemple, le très attendu jeu de tir à la première personne Quake utilisait un code assembleur hautement optimisé, conçu presque entièrement autour du FPU du P5 Pentium. En conséquence, le P5 Pentium a nettement surpassé les autres CPU dans le jeu.


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