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| RISC-V | ||
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 RISC-V prototipo de un procesador, enero de 2013. | ||
| Información | ||
| Tipo | RISC ISA | |
| Desarrollador | Universidad de California en Berkeley | |
| Datos técnicos | ||
| Conjunto de instrucciones | RISC-V | |
| Software | ||
| Sistema operativo | GNU/Linux | |
RISC-V es una arquitectura de conjunto de instrucciones (ISA) de hardware libre basado en un diseño de tipo RISC (conjunto de instrucciones reducido).
A diferencia de la mayoría de los conjuntos de instrucciones, el de RISC-V es libre y abierto y se puede usar sin regalías para cualquier propósito, lo que permite que cualquiera diseñe, fabrique y venda chips y software de RISC-V. Si bien no es la primera ISA de arquitectura abierta, es significativa porque está diseñada para ser útil en una amplia gama de dispositivos. El conjunto de instrucciones también tiene un cuerpo sustancial de software de soporte, que evita una debilidad habitual de los nuevos conjuntos de instrucciones.
El proyecto comenzó en 2010 en la Universidad de California en Berkeley, pero muchos colaboradores son voluntarios y trabajadores de la industria fuera de la universidad.
El conjunto de instrucciones se ha diseñado pensando en implementaciones pequeñas, rápidas y de bajo consumo para el mundo real,[1][2] pero sin una sobre-ingeniería excesiva que buscase una microarquitectura concreta.[3][4][5]
En mayo de 2017, estaba cerrada la versión 2.2 del conjunto de instrucciones del espacio de usuario[6]. El conjunto de instrucciones privilegiadas estaba disponible como borrador en la versión 1.10.
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- ↑ Error en la cita: Etiqueta
<ref>no válida; no se ha definido el contenido de las referencias llamadasshakti - ↑ Celio, Christopher. «CS 152 Laboratory Exercise 3». UC Berkeley. Regents of the University of California. Consultado el 12 de febrero de 2015.
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